1樓：匿名使用者
通過地址和資料匯流排來進行訪問，記憶體類似一個大的矩陣陣列，可以通過地址線找到相應的資料位置，然後記憶體將資料傳送到資料匯流排上，cpu可以讀取到。是經過快取記憶體cache來進行的，cpu要讀取一個資料時，首先從cache中查詢，如果找到就立即讀取並送給cpu處理；如果沒有找到，就用相對慢的速度從記憶體中讀取並送給cpu處理，同時把這個資料所在的資料塊調入cache中，可以使得以後對整塊資料的讀取都從cache中進行，不必再呼叫記憶體。
2樓：兲丅憮雙
填空的話是 儲存控制器 （記憶體控制器）
解釋cpu與記憶體的通訊方式
3樓：匿名使用者
從高階層面角度看，snb架構只是一次進化，但是如果看看nehalem/westmere以來電晶體變化的規模，絕對是一次革命。 core 2引入了一種叫作迴圈流檢測器(lsd)的邏輯塊，檢測到cpu執行軟體迴圈的時候就會關閉分枝**器、預取/解碼引擎，然後通過自身快取的微指令(micro-ops)供給執行單元。這種做法通過在迴圈執行的時候關閉前端節省了功耗，並改進了效能。
snb裡又增加了一個微指令快取，用於在指令解碼時臨時存放。這裡沒有什麼嚴格的演算法，指令只要在解碼就會放入快取。預取硬體獲得一個新指令的時候，會首先檢查它是否存在於微指令快取中，如是則由快取為其餘的管線服務，前端隨之關閉。
解碼硬體是x86管線裡非常複雜的部分，關閉它能夠節約大量的功耗。如果這種技術也能引入到atom處理器架構中，無疑也能使之受益匪淺。 這個快取是直接對映的，能儲存大約1.
5k微指令，相當於6kb指令快取。它位於一級指令快取內，大多數程式的命中率都能達到80%左右，而且頻寬也相比一級指令快取更高、更穩定。真正的一級指令和資料快取並沒有變，仍然都是32kb，合計64kb。
這看起來有點兒像pentium 4的追蹤快取，但最大的不同是它並不快取追蹤，而更像是一個指令快取，儲存的是微指令，而非x86指令(macro-ops)。 與此同時，intel還完全重新了一個分支**單元(bpu)，精確度更高，並在三個方面進行了創新。 第一，標準的bpu都是2-bit**器，每個分支都使用相關可信度(強/弱)進行標記。
intel發現，這種雙模**器所**的分支幾乎都是強可信度的，因此snb裡多個分支都使用一個可信度位，而不是每個分支對應一個可信度位，結果就是在分支歷史表中同樣的位可以對應更多分支，進而提高**精確度。 第二，分支目標同樣做了翻新。之前的架構中分支目標的大小都是固定的，但是大多數目標都是相對近似的。
snb現在支援多個不同的分支目標大小，而不是一味擴大定址能力、儲存所有分支目標，因而浪費的空間更少，cpu能夠跟蹤更多目標、加快**速度。 第三，提高分枝**器精度的傳統方法是使用更多的歷史位，但這隻對要求長指令的特定型別分支有效，snb於是將分支按照長短不同歷史進行劃分，從而提高**精度。
4樓：匿名使用者
sandy bridge通過處理器整合的記憶體控制器直接與記憶體進行通訊，繞過了其他晶片。
cpu在執行指令的時候,進行第二次訪問記憶體的目的是什麼？
5樓：路之舞者
解析了指令，當然下一步要具體操作了！去記憶體查詢內容，讀寫啊
cpu記憶體與外設介面之間資訊傳遞方法
6樓：四年又輪迴
cpu與外設之間資料傳送都是通過記憶體實現的。
外圍裝置和記憶體之間的常用資料傳送控制方式有四種
(1)程式直接控制方式：就是由使用者程序直接控制記憶體或cpu和外圍裝置之間的資訊傳送。這種方式控制者都是使用者程序。
(2)中斷控制方式：被用來控制外圍裝置和記憶體與cpu之間的資料傳送。這種方式要求cpu與裝置（或控制器）之間有相應的中斷請求線，而且在裝置控制器的控制狀態暫存器的相應的中斷允許位。
(3)dma方式：又稱直接存取方式。其基本思想是在外圍裝置和記憶體之間開闢直接的資料交換通道。
(4)通道方式：與dma方式相類似，也是一種以記憶體為中心，實現裝置和記憶體直接交換資料控制方式。
cpu和記憶體之間是怎麼進行資料傳輸的？
7樓：文化永生
只要計算機在執行中，cpu就會把需要運算的資料調到記憶體中進行運算，當運算完成後cpu再將結果傳送出來，記憶體的執行也決定了計算機的穩定執行。
平常使用的程式，如windows作業系統、打字軟體、遊戲軟體等，一般都是安裝在硬碟等外存上的，但僅此是不能使用其功能的，必須把它們調入記憶體中執行，才能真正使用其功能，平時輸入一段文字，或玩一個遊戲，其實都是在記憶體中進行的。
8樓：超級猛將
什麼意思?
記憶體載入資料,cup指導運算和資料的發配,傳輸和處理以二進位制數進行,儲存以asc碼進行~傻孩子
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